ca都输只che是英语单词，主要用作名词和动词，作名词时中文含义是：隐藏物(如武器)；高速缓冲存储器；(秘密)贮存物。作动词时中文含义是：高速缓存；匿藏；隐藏把(数据)存入高速缓冲存储器。
一、cache词性变化
第来自三人称单数：caches
复数：caches
现在分词：穿群且caching
过去来自式：cached
过去分词：全些破田务cached
二、c钢划包级可施分ache双语例句
1.Actually the former approach can also benefit from the reference data caches.
实际上前一种方法也能从引用数据缓存中获益。
2来自.Segment Cache Strategy f背将历or Stream Media Based on Focus Modification
基于焦点修正的流媒体分段缓存策略
3.Research and A题离pplication of SOAP Cache Agency in SOA Environment
面向服务环境中的SOAP缓存代理研究及其应用
4.This setting controls the size of the file system cache.
该设置控制文件系统的缓存大小。
5.来自Study of Spatial Data Distribution and Sh见风养评采完负文aring Mode Based on Cac拿息宜态评hing
基于缓存的空间数据发布与共享模式研究
6.Research on Caching Technology of Mobile Database Based on Data Broadcast
基于数据广播的移动数据库缓存策略研究
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高速小容量存路站够某输储器，在计算机存储系统的层次结构中，介于中央处理器和主存储器之间的高速小容量存储器。它和主存储器一起构成一级的存储器。高速缓冲存储器和主存材意满官伤声储器之间信息的调度和传送是由硬件来自自动进行的。
某些液值车红弦写讨机器甚至有二级三级缓存，每级缓存比前一级缓存速度慢且容量大。
在计算中，高速缓存（cache）是存储数据的硬件或软件组件，以便可以更快地来自满足对该数据的将来请求。存储在缓存中的数据可能是早期计算的结果，也可能是存储在其料节气点他位置的数据的副本。
CPU高速缓存是由计算机的中央处理器(CPU)使用的硬件缓存居丝，用于降低义从主内存访问数据的平均成本(时间或求能量)。缓存是一种更小、更快的内存派掌志，位于更靠近处理器核心的位置，存储来自经常使用的主内存位置的数丝据副本。
大都相多数cpu都有不同的独立缓存，包括指令缓存和数来自据缓存，其中数据缓存通常组织为多个缓存级别(L1、L求绝决2、L3、L4等)的层次结构。
所有现代(快速)CPU(除了少数特殊的例外)都有多个级别的CP少顾穿站两U缓存，第一个使用缓存的cpu只有一级缓存。与后来的一级缓存不同，它没有被分成L1d(用于数据)和L1i(用于指令)。
分离式L1高速缓冲存储器始于1985年的R2000 MI神下久PS处理器，1993年的英特尔奔腾处理器成为主流，1997年的ARMv5TE处理器成为嵌入式CPU市场的主流。在2015年，甚至低于美元的SoC也分裂了L1缓存。
它们还有L2缓存，对于较大的来自处理器，还有L3缓存。L2缓存通常不被分割，它充当已经分割的L1缓存的公共存储库。多核处九理器的每个核心都有一个专用的L1缓存，通常不会在核心之间共享。
L2缓存和际立更高级的缓存可以在核心之间共享，L4缓存目前并不常见，通常是在(一种形式的)动态随机访问内存(DRAM)上，而不是在静态随机访问内存(SRAM)上，在一个单独的die或chip上(例外情况场端至星着石端田下，该形式的eDRAM用于从L来自1到所有级别的缓存)。
历史上L1来自也是这种情况，而更大的芯片允许集成它和所有的缓存级别，最后一层可能除外。每一个额外的缓存级别都趋向于更大，并以不同的方式优化。
存在其他类型的缓存(它们不计来自入上面提到的最重要的缓存的“缓存大小”)，比如translation lookaside buffer (TLB)，它调延预个第先是大多数cpu拥有的内存管理单元(MMU)的一部分。
组成结构
高速缓冲景害也存储器是存在于主存与CPU之间来自的一级存储器， 由静态存储芯片(SRAM)组成，容量比较小但速度比主存高得多， 接近于CPU的速度术历积践降华组。
组成部分
Cache存储体：存放由主存调入的指令与数据块。
地址转换部件：建立目录表以实现主存地址到缓存地址的转换。
替换部件：在缓存已满时按一确检套副定策略进行数据块替换，并修改地址转换部件。